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自动化技术
> FPGA的PCIe接口及事物层设计
FPGA的PCIe接口及事物层设计
图片来源:
王嘉良,赵曙光.
用FPGA实现PCI-E接口和DMA控制器设计 ,
计算机技术与发展, 2011 (06).
>>查看本文图片摘要
图片关键词:
事物
硬核
所属学科:
自动化技术
图片上下文:
发挥PCIe接口性能。FPGA的PCIe接口设计包括XilinxPCIe端点硬核和面向事物层的应用逻辑设计2个部分,这里将详细给出应用层设计,如图1所示。图1 FPGA的PCIe接口及事物层设计XilinxPCIe硬核支持64-bit数据通路,分别用于发送和接收数据。该硬核提供6
....
个32-bit基地址寄存器BAR0~BAR5(BassAddressRegister,简称BAR),可以根据用户设计需求进行配置。在本设计中使用BAR0和BAR1组成一组64-bit地址空间,用于存储外部CPU访问FPGA内部寄存器地址。使用BAR2和BAR3组成另一组64-bit地址空间,用于存储DMAEngine控制器和缓存器地址。通过判断trn_rbar_hit_n[6:0]来区分BAR0和BAR2,其主要代码如下:……T`RN_RX_MEM_RD64_DW1DW2: begin …… req_bar0_o<=~trn_rbar_hit_n_q [0]; req_bar2_o<=~trn_rbar_hit_n_q [2]; ……end以外部CPU读FPGA内部寄存器为例, FPGA将收到的PCIe总线上数据帧经由硬核的事物层
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